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ZYNQ7000系列 MIO EMIO使用

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    PS GPIO介绍 Zynq7000系列芯片有54个MIO(multiuse I/O),它们分配在 GPIO 的Bank0 和Bank1隶属于PS部分,这些IO与PS直接相连。不需要添加引脚约束,MIO信号对PL部分是透明的,不可见。所以对MIO的操...

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2019-09-10

ZYNQ7000系列 UDP通信

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    前面介绍了官方给出的lwip协议。TCP协议在开发板中需要250ms和500ms调用一次拥塞控制和超时重传等操作,需要大量中断,程序处理速度会收到一定影响。 接下来重写main.c和几个UDP相关文...

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2019-09-09

ZYNQ7000系列 TCP通信

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    PL部分根据硬件电路选择对应的网络口,如图: ( 米尔开发板 需要注意,核心板没有提供原理图,有些芯片的复位脚由MIO引出,配置时需要注意,如果没有按照提供的示例设置,可能出...

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2019-09-09

ZYNQ7000系列 VIVADO2017.4程序固化问题

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    开发ZYNQ时,在VIVADO 2017.4在烧写QSPI FLASH时必须指定FSBL文件,貌似是17.3后新增的特性,指定默认生成的FSBL文件,提示烧写失败。 百思不得其解,只好上XILINX官网搜索,XILINX官网中AR705...

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2019-09-08

ZYNQ7000系列 DDR读取正确性

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    使用ZYNQ或者MPSoC的好处是可以通过PL逻辑设计硬件加速器,对功能进行硬件加速。加速器和ARM之间的交互信息一般包含自定义加速指令传递、待计算数据以及计算结果。这三种交互信息...

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2019-08-21